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      3. 如何在 VHDL 和 Verilog 中为 FPGA 设计设置 Eclipse)?

        时间:2023-09-25
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                  本文介绍了如何在 VHDL 和 Verilog 中为 FPGA 设计设置 Eclipse)?的处理方法,对大家解决问题具有一定的参考价值,需要的朋友们下面随着跟版网的小编来一起学习吧!

                  问题描述

                  我是 Eclipse 的新手,我已经将它用于软件开发和 Nios 处理器的 Altra 环境中.但现在,我有一个相当大的项目需要管理,我想使用 Eclipse 来拥有系统中的所有文件,以便更轻松地管理和更新.

                  I am new with Eclipse, I have used it for SW development and in Altra environment for Nios processor. But now, I have a pretty large project that I have to manage and I would like to use Eclipse to have all the files in the system to make it easier to manage and update.

                  该项目具有用于各种 IP 的多个目录,并具有用于 ASCI、Xilinx 和 Altera FPGA 的多个目标.在不久的将来,该项目将同时支持 NIOS、Microblaze 和 ARM 处理器,如果可能的话,我真的很想将整个项目保存在一个 Eclipse 项目文件中.我尝试了几种不同的选项,但似乎都无法正常工作.

                  The project has multiple directories for various IPs and has multiple targets for ASCI, Xilinx and Altera FPGAs. In a near future the project will support both NIOS, Microblaze and ARM processors and I would really like to keep the whole project in one Eclipse project file if possible. I have tried several different options, but nothing seems to work properly.

                  我正在寻找一些免费软件,而不是像 Sigasi 这样的商业程序.

                  I am looking for some freeware and not commercial programs like Sigasi.

                  提前致谢,法哈德

                  这是一个更新,让其他人知道我的进步.

                  This is an update to let others know about my progress.

                  好吧,我终于设法让它工作了.

                  Well, I finally managed to get it to work.

                  • 我在我的电脑上安装了最新版本的 Eclipse
                  • 安装了 Java 版本 6(我唯一可以开始工作的版本)
                  • 在 Eclipse 中安装了最新版本的 VEditor.
                  • 将Linux项目目录挂载为我PC上的P盘
                  • 在 Eclipse 中创建了一个新项目并将其链接到 P 盘上的项目.

                  花了一些时间来解决这个问题,但现在它可以完美运行.

                  It took some time to figure this out, but it now works perfectly.

                  推荐答案

                  这些是我知道的:

                  • Veditor(测试版) - http://sourceforge.net/projects/veditor/
                  • sigasi 免费 - http://www.sigasi.com/sigasi-starter-edition
                  • 标志(不再开发) - http://sourceforge.net/projects/signs/
                  • zamiaCAD(替代标志) - http://zamiacad.sourceforge.net/web/

                  这篇关于如何在 VHDL 和 Verilog 中为 FPGA 设计设置 Eclipse)?的文章就介绍到这了,希望我们推荐的答案对大家有所帮助,也希望大家多多支持跟版网!

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